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LVPECL差分晶體振蕩器時(shí)鐘源電路設(shè)計(jì)

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瀏覽：- 發(fā)布日期：2018-12-21 09:28:01【大中小】

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石英晶體振蕩器按照類(lèi)型可以分為多種類(lèi)別,而差分晶振則是有源晶振中高級(jí)別的.差分晶振相較于普通晶振而言,低電流電壓可達(dá)到低值1V,工作電壓在2.5V-3.3V,是普通貼片晶振所不能夠達(dá)到的,差分晶振具有低電平,低抖動(dòng),低功耗等特性.差分晶振作為目前行業(yè)中要求高的,技術(shù)高的石英晶體振蕩器,具有相位低,損耗低的特點(diǎn).差分貼片晶體振蕩器使用于產(chǎn)品中能夠很容易地識(shí)別小信號(hào),能夠從容精確地處理'雙極'信號(hào),對(duì)外部電磁干擾(EMI)是高度免疫的.

對(duì)于一個(gè)在這種電路設(shè)計(jì)的新手去設(shè)計(jì)一個(gè)ADC系統(tǒng),通過(guò)AD9269將1MHz到10MHz的模擬信號(hào)數(shù)字化.第一次看到數(shù)據(jù)表中的"時(shí)鐘輸入考慮"部分時(shí),是很困惑.根據(jù)理解,如果有一個(gè)低抖動(dòng)時(shí)鐘源(例如石英晶體振蕩器),那么基于PLL的時(shí)鐘發(fā)生器/分配器(例如數(shù)據(jù)表和評(píng)估板設(shè)計(jì)中推薦的AD9517)可能不是首選.

在設(shè)計(jì)中,將使用專(zhuān)用于AD9269的單個(gè)時(shí)鐘源.所以猜測(cè),使用單個(gè)低抖動(dòng)晶體振蕩器將是最佳選擇.主要考慮的是如何使用~10MHz模擬正弦輸入信號(hào)最大化ADC中的ENOB.如果有更合適的時(shí)鐘源設(shè)計(jì),請(qǐng)推薦.假設(shè)有源晶振(XO)是最佳選擇,我發(fā)現(xiàn)一些XO(例如LMK60E2-156M)提供<200fsRMS抖動(dòng)和LVPECL輸出(參見(jiàn)下表).

我決定使用這種XO,但是一旦我參考AD9269數(shù)據(jù)表來(lái)完成我的設(shè)計(jì),我就會(huì)遇到一些問(wèn)題：

(1)如果XO提供LVPECL差分晶振輸出,我還需要ADCCLK輸入和XOsrc輸出之間的平衡-或變壓器耦合的東西嗎?

(2)如果是這樣,你能否建議我如何配置XO的輸出到巴倫或變壓器?我想知道只需將地面終端更換為XO的輸出就足夠了.

(3)似乎AD9269接受高達(dá)480MHz的CLK頻率,內(nèi)部頻率分頻器提供最終采樣頻率.在ADC性能方面(ENOB,......),哪種時(shí)鐘源配置更好?

-高頻時(shí)鐘源和高N分頻(例如480MHzclksrc+/6div=80MHz晶振采樣頻率)

-低頻時(shí)鐘源且無(wú)分頻(例如80MHzclksrc+/1div=80MHz采樣頻率)

我找到了一個(gè)參考設(shè)計(jì),它似乎使用差分晶體振蕩器作為時(shí)鐘源,來(lái)自AD9467.我將XO配置為ADCCLK電路如下所示.

你能否檢查一下是否有任何錯(cuò)誤或任何評(píng)論?

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